Pseudo-Vectorization and RISC Optimization Techniques for the Hitachi SR8000 Architecture

Beitrag bei einer Tagung


Details zur Publikation

Autorinnen und Autoren: Hager G, Deserno F, Wellein G
Verlag: Springer-Verlag
Verlagsort: New York, LLC
Jahr der Veröffentlichung: 2003
Tagungsband: High Performance Computing in Science and Engineering, Munich 2002: Transactions of the First Joint HLRB and KONWIHR Status and Result Workshop, October 10-11, Technical University of Munich, Germany.
Seitenbereich: 425-442
ISBN: 3540004742


FAU-Autorinnen und Autoren / FAU-Herausgeberinnen und Herausgeber

Deserno, Frank
Lehrstuhl für Informatik 10 (Systemsimulation)
Hager, Georg Dr.
Regionales Rechenzentrum Erlangen (RRZE)
Wellein, Gerhard Prof. Dr.
Professur für Höchstleistungsrechnen


Zitierweisen

APA:
Hager, G., Deserno, F., & Wellein, G. (2003). Pseudo-Vectorization and RISC Optimization Techniques for the Hitachi SR8000 Architecture. In High Performance Computing in Science and Engineering, Munich 2002: Transactions of the First Joint HLRB and KONWIHR Status and Result Workshop, October 10-11, Technical University of Munich, Germany. (pp. 425-442). München: New York, LLC: Springer-Verlag.

MLA:
Hager, Georg, Frank Deserno, and Gerhard Wellein. "Pseudo-Vectorization and RISC Optimization Techniques for the Hitachi SR8000 Architecture." Proceedings of the High Performance Computing in Science and Engineering, München New York, LLC: Springer-Verlag, 2003. 425-442.

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Zuletzt aktualisiert 2018-10-08 um 12:10

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